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基本資訊

上班地點: 新竹縣竹北市高鐵二路32號3F-3
職務類別: 數位IC設計工程師 全職
需求人數: 2至3 人
更新日期:

工作內容

1. Develop Block/System/SOC level verification environment
2. Model/Bench development
3. Develop verificaiton plan and create effcient random test case
4. Low power and performance analysis/verification
5. coverage collect/report/improve

工作待遇: 待遇面議 (經常性薪資達4萬元或以上) 薪資行情

福利制度

1. 每月慶生會/員工活動,促進同事間的感情。
2. 每季部門聚餐。
3. 年會慶祝活動。
4. 年度員工旅遊。
5. 年度尾牙活動。
6. 年度優秀員工選拔,並有旅遊獎勵。
7. 社團活動並有經費補助(目前有籃球社、羽球社)。
8. 完善的教育訓練規劃及安排。
9. 結婚禮金、生育補助、喪葬津貼補助。
10. 工作地點於南通者,提供公寓式人才宿舍。
11. 工作地點於南通者,可享有員工購房優惠補助。
12. 工作地點於南通者,公司配有全職司機協助生活與業務接送。
13. 工作地點於南通者,提供定期返台休假與機票補助。

工作型態

出差外派: 需出差,一年累積時間未定
上班時段: 日班
休假制度: 依公司規定
管理責任: 不需負擔管理責任

條件要求

接受身份: 上班族
可上班日: 不限
工作經歷: 5年以上
學歷要求: 碩士
科系要求: 資訊工程相關、其他數學及電算機科學相關、電機電子維護相關
語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
擅長工具: Test ScriptsEDAVerilog
其他條件:
1. Knowledge of eMMC/SSD is a plus
2. Knowledge of NVMe/PCIe/DDR/NAND is a plus
3. Knowledge of ARM AMBA Bus protocols
4. Good knowledge of C/Verilog
5. Hands on experience on defining verification plan according to design specification (Block/SOC).
6. Hands on experience on building up pre/post simulation environment, including regression, coverage collection and improvement.
7. Familiar with SystemVerilog/UVM
8. Familiar with scripting language like Perl/Python/Tcl/Makefile

聯絡方式

聯絡人: 林小姐

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