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基本資訊

上班地點: 新竹市園區二路9號8樓(300)  (新竹科學園區)
職務類別: 數位IC設計工程師、類比IC設計工程師 全職
需求人數: 1 人
更新日期:

工作內容

1.5+ years experiences in ASIC/SOC circuitry design
2.IO, band-gap, DLL, PLL, POR, Comparator circuit design and modification
3.Familiar with IO circuit design, ESD protection mechanism , signal integrity quality control and IR drop related to mixed signal SoC integration
4.Familiar with Analog, memory IP, special standard cell behavioral model
Understand ASIC/SOC physical design flow stages and milestones
5.SOC/ASIC IO pin-pad assignment and review
6.Familiar with SOC analog IP integration, power plan
7.Familiar with ESD/Latch-up design review and fail analysis
8.Experience with SoC failure mode on EMMI/ORBICH methodology and debug strategy
9. Familiar analogy IP behavior model and timing lib creation or modification for SoC integration is a plus
10. Analog layout plan and layout review
11.English communication capability is a must

工作待遇: 待遇面議 (經常性薪資達4萬元或以上) 薪資行情

福利制度

◆ 分紅 / 配股
  1.員工紅利
  2.員工配股
  3.員工認股
◆ 獎金 / 禮品類
  1.年終獎金
  2.三節禮金/禮品
  3.勞動節獎金/禮品
  4.生日禮金/禮品
◆ 保險類
  1.勞保
  2.健保
  3.員工團保
  4.眷屬團保
  5.意外險
◆ 制度類
  1.伙食費
  2.介紹獎金
  3.績效獎金
  4.完整的教育訓練
  5.順暢的升遷管道
◆ 請 / 休假制度
  1.週休二日
  2.特休/年假
  3.陪產假
◆ 其他
1.美式人性化管理
2.員工停車位
3.免費健康檢查
4.特約商店
5.預享半個月薪資
6.彈性上、下班
7.每季員工溝通座談會
8.提供加班免費晚餐
◆ 補助類
  1.結婚禮金
  2.生育津貼
  3.員工進修補助
 

工作型態

出差外派: 需出差,一年累積時間約一個月以下
上班時段: 日班,09:00~18:00
休假制度: 週休二日
管理責任: 不需負擔管理責任

條件要求

接受身份: 上班族
可上班日: 不限
工作經歷: 5年以上
學歷要求: 大學、碩士
科系要求: 電機電子工程相關、資訊工程相關
語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
擅長工具: VerilogVHDL
其他條件:
Verilog、VHDL、FDGA
1. Skilled Verilog HDL / VHDL coding and simulation tool
2. Synopsys synthesis tool.
3. Perl/C/shell coding.
4. Skilled at FPGA.
5. Skilled in Architecture Define.
6. Experience in MCU design
7. Proven IC design with embedded CPU SOC.

聯絡方式

聯絡人: 人事部
電話: 03-5678568-851
其他: 可使用104履歷應徵或將詳細履歷自傳寄至parishsu@e2-solutions.com.tw

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