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基本資訊

上班地點: 新北市土城區忠承路109號3樓
職務類別: 硬體研發工程師、數位IC設計工程師、韌體設計工程師 全職
需求人數: 1至3 人
更新日期:

工作內容

a. CPLD/FPGA design for embedded platforms.
b. Familiar with HW platform testing related to CPLD/FPGA design.
c. Co-work with Hardware / Software team to debug and find out the root cause.
d. Maintain the current CPLD project.
e. Writing the CPLD specification.
f. Familiar with switch HW design or x86 CPU design is plus.

工作待遇: 待遇面議 (經常性薪資達4萬元或以上) 薪資行情

福利制度

◆薪資福利
1.中秋/端午/年終獎金及禮券
2. 結婚禮金
3. 生育禮金
4. 推薦人才獎金
5. 績效及專案獎金
6. 生日禮券
7. 季度發放電影票及購物禮券

◆安心保險
1. 出差旅平意外險
2. 團體保險:包含配偶與子女
3. 優質健康檢查方案

工作型態

出差外派: 需出差,一年累積時間未定
上班時段: 日班
休假制度: 週休二日
管理責任: 不需負擔管理責任

條件要求

接受身份: 上班族、應屆畢業生、外籍人士、原住民【相關法令】、二度就業、中壯齡(45~54歲)、中高齡(55~64歲)
可上班日: 不限
工作經歷: 不拘
學歷要求: 碩士以上
科系要求: 電機電子工程相關、通信學類、數學及電算機科學學科類
語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
其他條件:
Experienced or interested in following topics :
#1 5G RAN related FPGA implementation.
#2 CPRI/ROE/eCPRI IP design.
#3 FPGA based HW accelerator design.
#4 Familiar with embed FPGA-SOC architecture.
#5 switch or x86 CPU platform related CPLD design.
#6 Edge computing or ML/AI related FPGA design.

聯絡方式

聯絡人: NanaHsieh

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