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基本資訊

上班地點: 台北市內湖區行善路158號
職務類別: 硬體研發工程師、電子工程師 全職
需求人數: 3 人
更新日期:

工作內容

1. FPGA Development for server applications , including IC design , Verilog coding , Simulation , Timing closure , Debug and Project maintenance.
2. Validate and Debug FPGA on prototype hardware system.
3. Co-work with Hardware and Software engineers in development.
4. Participate HPC server chassis architectural design.

工作待遇: 待遇面議 (經常性薪資達4萬元或以上) 薪資行情

福利制度

1.每週上班五天、彈性上下班
2.員工分紅、績效獎金
3.完善的教育訓練體系
(1)OJT(On the job training工作現場訓練)
(2)海外據點訓練 (3)新進人員訓練、(4)職能別專業訓練體系
(5)管理才能訓練體系 (6)內部師資培訓練體系
(7)TQM訓練系 (8)國際化訓練體系 (9)IT應用訓練體系
(10)自我啟發訓練體系

4.體貼的辦公環境
(1)員工餐廳(新竹廠區) (2)健身中心(台北公司) (3)籃球場 (台北公司)
(4)韻律教室 (5)銀行代辦處 (6)保險諮詢

5.豐富的福利項目
(1)遍及基隆、雙北、桃園與新竹之免費交通車(依各區實際情況而定)
(2)生育補助每胎6萬 (3)有薪活力假
(4)公司全額補助團體保險(員工本人壽險、意外與住院醫療險) (5)婚喪喜慶與急難補助
(6)生日、三節福利金 (7)多元社團活動 (8)定期電影欣賞會(台北公司)
(9)國內外旅遊活動與補助 (10)員工生涯發展與諮商中心
(11)優秀員工表揚與獎勵 (12)各式民生消費用品特賣

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工作型態

出差外派: 無需出差外派
上班時段: 日班
休假制度: 週休二日
管理責任: 不需負擔管理責任

條件要求

接受身份: 上班族、應屆畢業生
可上班日: 不限
工作經歷: 1年以上
學歷要求: 大學、碩士
科系要求: 電機電子工程相關、資訊工程相關
語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
擅長工具: Verilog
其他條件:
1. 1年以上FPGA或CPLD開發經驗
2. 具有開創性及解決問題的能力
3. 具備客戶導向及良好溝通技巧
4. 具Altera 或 Lattice FPGA/CPLD 相關開發經驗佳
5. 熟X86硬體架構經驗佳
6. 熟 Logic Analyzer與Scope經驗佳
7. 無Server相關經驗可

聯絡方式

聯絡人: HR

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