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C組-應用系統開發及維護人員(工作地點:台北巿松山區)

  • 台北市松山區
  • 經歷不拘
  • 大學

一、大學(含)以上資訊相關科系畢業、或非相關科系畢業但接受過三至六個月資訊 專業課程訓練及一年以上相關工作經驗。 二、須具備SQL語法及任一程式語言開發能力(如Java、C、C++等),具備可自行撰 寫SQL指令與使用熟悉程式語言執行開發之能。 三、需有良好邏輯能力、抗壓性高、具責任感及團隊合作精神並樂於溝通。 四、願意配合工作需要安排加班、調整工作時段及支援系統問題處理。 加分條件: (1)熟JavaScript等前端軟體開發程式能力者佳。 (2)熟手機APP程式開發經驗者佳。 (3)具備資料庫開發設計、ProC、JavaScript與JSP/Servlet等軟體開發經驗者佳。 (4)具備Linux或UNIX作業系統使用經驗者佳。 (5)具備新創技術應用經驗者佳。新創技術如:區塊鏈、FIDO及大數據等。 (6)能與團隊合作及具良好溝通能力尤佳。 (7)具信用卡支付產業相關經驗者佳。 (8)具英文聽、說、讀、寫能力佳。 ※筆試、性向測驗: 113年4月20日(六)於台北市舉辦;考試科目:國文(論文與公 文)、英文(選擇題)、性向測驗、計算機概論與程式設計(選擇 題)。 ※面試:預訂於113年5月2日至3日間舉辦。 【福利與待遇】 1、月薪:NT$39,925~NT$53,845(技術加給另計)。 2、福利:年終獎金、三節福利金、團保、健康檢查、自強活動、生日禮券、生育津貼及 子女教育津貼等。

11~30人應徵

Senior Software Engineer

  • 台北市信義區
  • 5年以上
  • 大學

Minimum qualifications: • 資訊工程、電腦科學、相關技術領域的學士學位,或同等的實務經驗。 • 至少5年以上網站開發經驗。 • 精通 MySQL 等關聯式資料庫並熟悉撰寫高效能的 SQL 語法。 • 熟悉 Restful API 設計、實現以及串接。 • 熟悉 Linux 環境開發。 • 各種第三方 API 串接。 • 熟悉 JSON, XML 格式。 • 熟悉任一種 Script language (Perl, PHP, Python etc.) Preferred qualifications: • 擁有與產品經理以及跨部門合作的經驗。 • 具有管理軟體開發專案的經驗。 • 參與過每秒處理數萬筆 requests 的大型軟體開發經驗。 • 優秀的設計、編碼和執行能力。 • 具備良好的溝通技巧。 • 良好的系統設計能力,能夠設計高可用、可擴展的系統架構。 • 熟悉編寫單元測試和整合測試。 Responsibilities: • 與產品經理密切合作,定義產品功能以及規劃可交付成果和里程碑。 • 理解公司任務,能獨立進行有效的跨部門溝通與協調,並與同事合作完成專案。 • 做出直接的技術貢獻,能為團隊成員提供指導。 • 參與整體軟體開發流程,撰寫閱讀度佳及可靠的程式,並且協助維護伺服器。 • 整合商業夥伴的產品及數據至 MediaAlpha 系統,讓我們的夥伴可以透過 MediaAlpha 平台分析了解自己的數據並拉升各項指標。 • 使用 Script language (例如 Perl) 在 Linux 系統下開發軟體並協助 AWS 維護工作(EC2, S3 or CloudFront etc.) Plus: • 有 ReactJS 使用經驗。 • 了解及應用 Redis。 • 擁有Perl 相關經驗。(非必須,可進來學習) Monthly Salary: 85k-110k Full Package (Monthly Salary+ Bonus + RSU): About 1.5M-2.2M

大於30人應徵

3/27 CPLD/FPGA工程師

  • 新北市汐止區
  • 2年以上
  • 大學

【工作內容】 1. 數位電路邏輯控制程式設計 2. 基本通訊界面控制 (UART/I2C/SPGIO/SPI) 3. CPLD規格評估 4. CPLD規格書規劃、撰寫、維護 5. Verilog/VHDL模擬除錯設計 6. CPLD測試、除錯、驗

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11~30人應徵

3/11 (NR24- ) CPLD 韌體技術副理/技術經理--網路通訊事業群

  • 新北市中和區
  • 經歷不拘
  • 專科

、網路資通安全、負載平衡、路由器、網路監控錄影主機 (NVR)、網路儲存伺服器(NAS)等。 【工作職責】 1. CPLD/FPGA design for X86 system. 2. Co-work with Hardware/Software

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0~5人應徵

3/21 雲端基礎設施系統與平台事業部-MB/Server FPGA/CPLD 資深程師(新莊)

  • 新北市新莊區
  • 4年以上
  • 大學

需求). 2.模擬編輯訊號控制介面 (例如 : SM Bus/JTAG/SPI/eSPI/SGPIO等). 3.FPGA /CPLD/MCU 規格評估與回饋. 4.FPGA /CPLD/MCU 規格制定、編程實現並提供後續的維護服務. 5.透過軟體

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0~5人應徵

3/22 【Server】CPLD Firmware Engineer

  • 台北市中山區
  • 2年以上
  • 專科

-Familiar with Lattice architecture and good relationship with vendor -Familiar with Intel Whitley / Eagle Stream or AMD Genoa power on sequence control -Familiar with DCSCM topology design, DCSCM 2.0 will be plus -Familiar with I2C Mux, I/O Expander, SPI Mux, Hot-plug control… module design coding -Familiar with Verilog, C/C++ -Experience in PER/ROT solution design coding -Experience in Altera architecture

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0~5人應徵

3/28 硬體研發工程師 (Hardware Design Engineer) - 工作地點:新竹

  • 新竹市
  • 經歷不拘
  • 大學

1. Ethernet Switch hardware design, debug, evaluation, and verification 2. Responsible for PCB material selection (SI/PI considered), schematics design, PCB layout constraint & review, HW DVT test and 2nd source verification...etc. 3. Writing and maintaining the hardware specification of the projects, failure analysis report if needed 4. Study tools & instruments for design & validation

待遇面議 員工150人
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0~5人應徵

3/29 FPGA工程師

  • 台中市北屯區
  • 經歷不拘
  • 專科

1. 負責 FPGA 功能驗證、程式開發、測試、除錯及維護 2. 熟悉 FPGA: >> Familiar with Verilog RTL design. >> Familiar with RTL simulation, timing analysis using Xilinx Vivado Design Suite. >> Familiar with FGPA digital validation and test pattern generation using (system)ILA, logic analyzer, high-speed oscilloscope, etc. >> Familiar with Xilinx FPGA serdes IO, and selectIO. >> Familiar with Xilinx IP design and packaging. >> Familiar with at least one Xilinx FPGA device. >> Familiar with Xilinx HLS is a plus. >> Familiar with Xilinx Zynq SoC is a plus. 3. 熟悉 Xilinx、Altera FPGA 架構與設計 4. 熟悉 VHDL、Verilog、C、C++ 等 5. 具I2C、SPI通訊介面運作經驗者

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0~5人應徵
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